[Modified] remove div diu ip use div.v instead
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@@ -48,6 +48,14 @@ module mycpu_top(
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wire [`ES_TO_LU_BUS_WD -1:0] es_to_lu_bus;
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wire lu_to_es_bus;
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wire es_div_enable;
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wire es_div_sign;
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wire [31:0] es_rf_rdata1;
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wire [31:0] es_rf_rdata2;
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wire div_complete;
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wire [31:0] div_result;
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wire [31:0] mod_result;
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// IF stage
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if_stage if_stage(
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@@ -116,8 +124,27 @@ module mycpu_top(
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.data_sram_en (data_sram_en ),
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.data_sram_wen (data_sram_wen ),
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.data_sram_addr (data_sram_addr ),
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.data_sram_wdata(data_sram_wdata)
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||||
.data_sram_wdata(data_sram_wdata),
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// div
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.es_div_enable (es_div_enable) ,
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.es_div_sign (es_div_sign) ,
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.es_rf_rdata1 (es_rf_rdata1) ,
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.es_rf_rdata2 (es_rf_rdata2) ,
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.div_complete (div_complete)
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);
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// div
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div u_div(
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.div_clk (clk ),
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.reset (reset ),
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.div (es_div_enable ),
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.div_signed (es_div_sign ),
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.x (es_rf_rdata1 ),
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.y (es_rf_rdata2 ),
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.s (div_result ),
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.r (mod_result ),
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.complete (div_complete )
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);
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// MEM stage
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mem_stage mem_stage(
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.clk (clk ),
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@@ -138,8 +165,13 @@ module mycpu_top(
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//to fw
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.ms_to_fw_bus (ms_to_fw_bus ),
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//to es
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.ms_to_es_bus (ms_to_es_bus )
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.ms_to_es_bus (ms_to_es_bus ),
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//div
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.div_result (div_result ),
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.mod_result (mod_result )
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);
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// WB stage
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wb_stage wb_stage(
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.clk (clk ),
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